2019-03-18 (月) 11:33:49

Active-HDLのテストベンチの生成方法を説明します。

ここではLattice Diamond1.3付属のActive-HDLがWindowsXPにインストールされていることを前提とします。

更新履歴

  • 2011-10-26 新規

ドキュメント

シミュレーションするモジュールを作成する

ここでは、Lattice DiamondIPexpressで生成したPLLモジュールを動かします。

PLLのブロックダイヤグラムを以下に示します(HandBookより抜粋)。

01.png

IPexpressでは以下のように、10MHz入力から、50MHzと、25MHzを生成する設定にします。

02.png

ワークスペースの作成

03.png

「File」−「New」−「Design」をクリックします。


04.png

「Create an Empty Design」を選択し、「次へ」をクリックします。


05.png

「次へ」をクリックします


06.png

デザイン名を入力し「次へ」をクリックします。


07.png

「完了」をクリックします。

ワークスペースが作成されます。

シミュレーションモジュールを追加する

08.png

「Design Browser」の「Files」タブで「Add New File」をダブルクリックします。


09.png

「Add Existing File」をクリックします。


10.png

シミュレーションするモジュールを選択します。

ここで「Make local copy」にチェックがあると、モジュールファイルをワークスペースにコピーします。

テストベンチを生成する

11.png

「Design」−「Compile All」をクリックし、モジュールをコンパイルします。


12.png

「Tools」−「Generate Testbench...」をクリックします。


13.png

シミュレーションするモジュールを選択し「次へ」をクリックします。


14.png

「次へ」をクリックします。


15.png

「はい」をクリックします。


16.png

「次へ」をクリックします。


17.png

「完了」をクリックします。


18.png

テストベンチが生成されます。

ライブラリを設定する

19.png

「Design」−「Settings...」をクリックします。


20.png

「Compilation」−「Verilog」を展開し、ライブラリを追加します。


21.png

「ovi_machxo2」を選択し「OK」をクリックします。


22.png

「Simulation」−「Verilog」を展開し、同様にライブラリを追加します。

信号を生成する

23.png

「Design」−「Compile All」をクリックします。


24.png

「Design Browser」のプルダウンメニューから、「pll_tb」を選択します。


25.png

「File」−「New」−「Waveform」をクリックします。


26.png

Waveformが作成されます。

「pll_tb」を展開します。


27.png

下位モジュール(シミュレーションするモジュール)を右Waveformにドラッグします。

信号(クロック)を生成したいピンにカーソルをあて、右クリックし「Stimulators...」をクリックします。


28.png

「Clock」を選択し「Apply」、「Close」をクリックします。

シミュレーションの実行

29.png

「Simulation」−「Run For」をクリックします。


30.png

入力されている時間だけ、シミュレーションが実行されます。

もう少し長くシミュレーションしてみます。


31.png

時間を「100 ns」から「100 us」にし、再度「Simulation」−「Run For」をクリックします。

入力クロック(CLKI)が10MHz、CLKOPがその5倍の50MHz、CLKOSが25MHzであることが確認できます。


32.png

モジュールの立ち上がり部分の確認。

850nsあたりでLOCKがHighになっているのが確認できます。

入力信号を変化させる

33.png

50%でない波形をつくってみます。


34.png

PLLを通すと整形されています。

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Last-modified: 2019-03-18 (月) 11:33:49 (124d)